CADENCE schematic /layout design中的callback - EE版

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EE版 - CADENCE schematic /layout design中的callback

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a******e
发帖数: 80

在指定transistor's 的尺寸时，当确定了width strip和number of gates后，应该自
动计算出total width，但是我的callback function被turned off了，哪位大虾知道怎
么把它enable啊
谢谢，我用的virtuoso schematic

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