w****x 发帖数: 2483 | 1 凑个热闹
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w****x 发帖数: 2483 | 2 Google,
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d******e 发帖数: 164 | 3 Mark:
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d******3 发帖数: 232 | 4 顶,也是fresh的时候第一个onsite 拿到offer。而这次跳槽fail了10个onsite,分别
是Google, Amazon, Microsoft, palantir, cisco, Tabula,KLA-Tencor,Mathwork,
synopsys, Fluigm,整整被折磨了半年,之前的150题,Leecode也做得非常熟,就是EE
转CS的C++码工. |
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g*********e 发帖数: 14401 | 5 面synopsys 9个人里6个老印 都是名字巨长的
幸好还有俩老中 |
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h*********g 发帖数: 42 | 6 Post for a friend. Do not contact me ...
All these position is in Mainland China.
Please send your resume to m**********[email protected]
Title as "Name - Position Name"
*******************************************************************
Position Separation
*******************************************************************
The Position Principal/Consulting Software Engineer
Position Summary
Reporting to the head of the storage team, the Principal/Consulting Software
Engineer will play a pivotal r... 阅读全帖 |
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T**e 发帖数: 191 | 7 Google
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s****a 发帖数: 238 | 8 synopsys,就是这么简单
工作中最大的困难不是什么算法或基础知识,是把别人写的那堆东西看懂 |
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t****2 发帖数: 125 | 9 手机不好贴链接啊
Evan Burfield, Co-founder, 1776; Maury Blackman, President & Chief Executive
Office, Accela; Khaled Naim, Co-founder & Chief Executive Officer, Addy Inc
.; Darrell Ford, Chief Human Resources Officer, Advanced Micro Devices (AMD)
; Pankaj Jindal, Chief Operating Officer, Akraya Inc.; Hannah Kain, Chief
Executive Officer , ALOM; Eric Davidson, President, American Automation &
Communications, Inc.; David A. Raymond, President & Chief Executive Officer,
American Council of Engineering Co... 阅读全帖 |
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a******n 发帖数: 55 | 10 SoC Physical Design Engineer
This individual will contribute from RTL to GDS on block level designs.
Specific tasks will include but not limiting the following:
- design floor planning,
- place and route,
- CTS, timing analysis
- physical design verification.
Job Requirements:
-MSEE or MSCS w/ 3+ yrs experience of digital physical design.
-Experience with RTL 2 GDSII concepts and flows.
-Requires good programming/scripting skills in Perl, TCL or Python.
-STA e... 阅读全帖 |
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a******n 发帖数: 55 | 12 SoC Physical Design Engineer
This individual will contribute from RTL to GDS on block level designs.
Specific tasks will include but not limiting the following:
- design floor planning,
- place and route,
- CTS, timing analysis
- physical design verification.
Job Requirements:
-MSEE or MSCS w/ 3+ yrs experience of digital physical design.
-Experience with RTL 2 GDSII concepts and flows.
-Requires good programming/scripting skills in Perl, TCL or Python.
-STA e... 阅读全帖 |
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s******n 发帖数: 179 | 13 PHD即将毕业。专业是ECE device方向的,research主要做graphene和硅的集成,以及
各种device应用。组很小,所以几乎全套的工作都是我做的。做过fabrication,
characterization,modeling,reliability。比较懂device physics 和 fabrication
process。
另外,有过两次暑期实习经验。全在半导体公司。一次做process engineering,主要
是CMP modeling。第二次是device engineering,做device design,layout,测试。
主要是digital & analogy CMOS 和 BJTdevice,还有power device。
我个人学习能力比较强,基本上手都比较快。本科是学物理的,PHD转到ECE,快速上手
,4年多点,就把PHD搞定。journal和conference 一共10几篇。很多东西都是自学的,
所以个人能力请放心。
真心求refer。各大/小半导体公司。technology development的工作,最好是device... 阅读全帖 |
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r***0 发帖数: 406 | 16 1. Besides hardware asic companies, you can also try EDA (synopsys, cadence)
. They are developing IP and need ASIC engineers. FPGA companies (Xilinx,
Altera)
2. I see people come here to discuss s/w interview questions, but almost no
people share and discuss h/w ones. You guys who applying for h/w jobs should
together start the thread (sharing questions, discussing potential good
answers). H/W's textbooks at some point are different from the real industry
.
3. Go to some free conference, fair, ... 阅读全帖 |
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t*********n 发帖数: 5 | 17 大家好,
很纠结于两个offer,大家帮我看看吧。。希望有过来人给我些意见,自己才刚毕业。。。
1. synopsys,base 120K, 11% bonus, 10K relocation, 5K sign on, 没股票,做的
是design compiler
2. marvell, based 107K, 6K relocation, 5K sign on, 900 RSU, 另外没说bonus,只
说bonus会基于公司和个人的表现来给。。。做的是ssd controller firmware
都在湾区。
自己认为选1的好处: 软件公司待遇一般好些,以后跳槽goolge什么的选择可能会多些
, desigh compiler估计也应该是公司1的核心产品吧。。
选2的好处: 2其实我已经accept offer一个月了,现在反悔很不好,我知道,但是1是
我接受offer之前投得职位,我觉得放弃可惜了就去试试了,自己研究生做的其实也是
偏硬件一些的编程,所以说兴趣的话还是2多一些。。。另外做的是ssd controller,好
像算是公司2比较核心的产品吧。。。另外公司2的食堂不... 阅读全帖 |
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p*******2 发帖数: 50 | 20 apple, linear tech , maxim, altera, Xilinx, synopsys 这些是不错 可是好坑太
少了 就这么几家 还有很多有经验有资历的人 年轻人想出头不容易 而且大势是半导体
行业越来越成熟 机会越来越少 到一个还在高速发展的行业拼一下 应该是个好主意
了,和FLG比应该不过分。硬工里面,maxim应该给的也不错,staff见到过base 16万,
了。skyworks要看,刚进去工资不高,但它慢慢给rsu,最后也还可以,不过加州那边行
比上不足比下有余了。 |
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i********c 发帖数: 11 | 21 小弟PhD candidate 今年12月毕业,现在开始投简历,希望得到各位业界前辈的内推!
PhD research包括LED and TFT fabrication:mask design, process flow(PECVD,PLD,
photolithography, RIE, ebeam, FIB), device characterization(AFM, SEM,
parameter analyzer, probe station). 也会应用Synopsys TCAD 做Simulation, 包括
Process Simulation, Device Simulation, Structure Editor.
上学期间还修了VLSI课程, 包括ASIC Design和Physical Design, 虽然对Device的工作
没有太大帮助,还是列出来,万一哪家公司需要......
编程语言包括C++, Python, Tcl, Make, Verilog, Matlab
需要详情或者简历请联系[email protected]
(function(){try{var... 阅读全帖 |
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p*******2 发帖数: 50 | 22 cong! 之前也是搞eda的 不过就做了2年 感觉整个行业都了无生气
面试L家的时候 还碰到一个从synopsys出来的伊朗大哥 那感觉。。。 |
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s****n 发帖数: 2305 | 23 EDA?
Synopsys? Cadance? Mentor?
要说EDA也不会垮啊,毕竟是上游企业,下面买tool的公司大把大把的,每年交license
的钱也不少。这个行业可以做到退休的啊。 |
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P**********c 发帖数: 3417 | 24 EDA这个行业当然不会消失,但是几大EDA公司近几年的增长都是靠转型做IP得来得。做
IP需要得是电路设计人才,不是EDA的老套路。事实证明几分钱一个的廉价IP拓展市场
比几十万一套昂贵EDA软件容易得多。Synopsys转型IP最早,现在境况最好。Core EDA
能做的基本都做了,可做的东西已经不是很多,需要的人只会越来越少。
EDA一个很大得问题就是它得营收跟最后芯片卖得如何是没有直接关系得。它只跟公司
的design effort有关,Qualcomm或者intel不会因为它这个季度芯片卖得特别好就多给
EDA公司一分钱。EDA在IC的位置就跟compiler在软件里的位置是一样的。产品做出来了
工具就丢了。这个产品卖的怎样跟这个工具就没关系了。不一样的就是FPGA的EDA软件
,是绑在芯片上的,所以FPGA公司过的也比纯EDA好一点。这个尴尬的位置养活这几家
EDA公司这么多年已经很不容易了。IP的model为什么好?因为IP是嵌到芯片里的,可以
收royalty, 卖多少芯片我可以抽成。
哪里有大把大把的公司在买tool, 就那么几家大客户,还是consolidate的趋势... 阅读全帖 |
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p*******2 发帖数: 50 | 25 大牛所言极是 eda依附于一个margin低的行业 真是坑了自己 半导体公司业绩好 eda能
活得好些 要是业绩不好 eda就惨了 听说synopsys在中国的分部都开到武汉去了。。。
看到不少读eda方向phd的大牛 最后都投靠了flg 感觉年轻人在eda这个行业混 把锐气
都混没了 想跳还是尽快跳的好
EDA |
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a********g 发帖数: 24 | 26 谢谢你,不过感觉他们要求都很高,特别是synopsis,mentor graphics.
不过我立马上网搜个列表,晚上挨着投一遍 |
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z***m 发帖数: 1602 | 27 不是写了cadence吗?
话说不少cadence或者synopsis的,都跳去FLG。
这年头,coding强还在semiconductor混的不多了。 |
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g*********e 发帖数: 14401 | 28 synopsys 9 轮 一边吃中饭一边问问题 |
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e*******s 发帖数: 147 | 29 各位牛人哥哥姐姐大家好!
我是刚毕业的硕士,人在湾区,但不介意relocation,有过一年的美国大公司实习经验
,想找一下Digital ASIC的职位,Design, Verification,Validation,Application
我都愿意做,恳求各位牛人哥哥姐姐内推一下,不胜感激!
下面是我的skill set,请站内联系或邮件[email protected]
/* */
我知道不能白白让您帮忙,如果合适的话,事成之后我送您500~1000刀的礼物作为感
谢!
SKILL-SET
Specialties: ASIC Digital Design, Verilog (RTL) Coding, C/C++, PERL/TCL/
Python, SystemVerilog
STA: Timing model generation, Static Timing Analysis, Timing Closure, Power
and clock distribution, Set-up and Hold, Timing Fix
Backend design: Syn... 阅读全帖 |
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j********8 发帖数: 136 | 32 原来做ASIC,现在转software的,但是年限不长的,可以投吗 |
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f*******r 发帖数: 55 | 33 我们的工作基本上是software development。时间不长会有一点减分。不过只要技术上
没问题,我觉得还是可以试试的。 |
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b**********5 发帖数: 7881 | 34 assert property(@posedge (clk)) a;
?? 都忘了。。。 我在那里干活的时候, 全floor, 就我一个女的, 和另外一个
russian/eastern european的女的。。上厕所, 很舒服。。。 |
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f*******r 发帖数: 55 | 37 发现收到的很多简历都是有比较强的硬件背景(教育和工作经验)还是没有太多的软件
开发经历。
为了避免浪费大家的宝贵时间,想做两点说明:
1、我们组的职位是软件工程师,大部分工作是做各种软件性能优化;
2、虽然招聘的职位是需要有3-5年以上的经验,我们一样会考虑没有太多工作经验但是
在软件开发/算法上面比较优秀的应聘者 |
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h**********e 发帖数: 4328 | 38 能给多少钱啊?
钱少当然找不到experienced coder了 |
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f*******r 发帖数: 55 | 39 你如果有兴趣,可以在网上查一下。我好像以前在哪里见到过。同一级别的应该差别不
会太大。 |
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x*****3 发帖数: 7 | 42 小弟今年5月硕士毕业,IC设计,数字VLSI方向,主要有:
Architecture design
RTL capture/simulation
FPGA prototyping
Synthesis
Physical design (P&R, CTS)
Physical verification (DRC, LVS, PEX, STA)
之前在Cypress Semi实习过,工作是SRAM设计和物理验证.
对整个ASIC design flow,特别是后端很有经验,熟悉Cadence/Synopsys/Mentor
Graphics CAD工具.
想在IC公司招个职位,希望能得到内推机会.如果需要简历请和我联系: wakenaway@
hotmail.com |
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f*******r 发帖数: 55 | 43 能否烦请版主将这个职位信息也加入置顶的贴子里。我们大组今年会在较长的时间内一
直有职位空缺,希望能帮助到正在找工作的同胞。 |
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c*******e 发帖数: 19 | 44 简历已发,请查收!
/* */
-
challenges |
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r*******e 发帖数: 7583 | 49 EDA不是夕阳,难道是如日中天?
标准的养老产业 |
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b**********5 发帖数: 7881 | 50 EDA从来就不火, 但也从来不夕阳。。。
life is not black or white。。。 |
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