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发帖数: 80 | 1 代人发帖，请指教，谢谢
我有一个数字设计，是在Cadence Virtuoso里用foundry提供的standard digital
cells建的 schematic，然后用"Virtuoso verilog environment for NC-Verilog"生成
verilog网表。在这个网表里，这些digital cell的连接是按端口的位置对应连接, 而
不是用端口名对应连接,比如:
NO2X1 I70 ( nQ, SET, Q);
NO2X1 I71 ( Q, nQ, RESET);
注： NO2X1是一个两输入NOR门
将这个网表作为输入文件导入到Encounter时，出现如下错误信息：
**ERROR: (SOCVL-349): Missing module definition in netlist for NO2X1.
**ERROR: (SOCVL-209): [./SR_latch_5V.v:16]: Parser does not handle
connection-by-position for this module.
at ,.
**ER |
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